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Rapport (Rapport De Recherche) Année : 2003

More on Modulo 2n -1 Addition

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Résumé

This brief paper describes an improvement of the FPGA implementation of the modulo (2^n-1) adder investigated in a previous research report.
Ce petit article décrit une amélioration FPGA de l'additionneur modulo (2^n-1) décrit dans un précédent rapport de recherche
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RR2003-14.pdf (130.98 Ko) Télécharger le fichier
Origine : Fichiers produits par l'(les) auteur(s)

Dates et versions

hal-02102102 , version 1 (17-04-2019)

Identifiants

  • HAL Id : hal-02102102 , version 1

Citer

Jean-Luc Beuchat. More on Modulo 2n -1 Addition. [Research Report] LIP RR-2003-14, Laboratoire de l'informatique du parallélisme. 2003, 2+2p. ⟨hal-02102102⟩
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